Cypress SemiconductorメーカーCY7C1292DV18の使用説明書/サービス説明書
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9-Mbit QDR- II™ SRAM 2-W ord Burst Architecture CY7C1292DV18 CY7C1294DV18 Cypress Semiconductor Corpora tion • 198 Champion Cou rt • San Jose , CA 95134-1 709 • 408-943-2 600 Document #: 001-00350 Rev .
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 2 of 23 Logic Block Diagram (CY7C1292DV18) CLK A (17:0) Gen. K K Control Logic Address Register D [17:0] Read Add. Decode Read Data Reg. RPS WPS Q [17:0] Control Logic Address Register Reg.
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 3 of 23 Pin Configurations CY7C1292DV18 (5 12K x 18) 23 4 5 6 7 1 A B C D E F G H J K L M N P R A CQ NC NC NC NC DOFF NC NC/144M NC/36M BW.
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 4 of 23 Pin Definitions Pin Name I/O Pin Descrip tion D [x:0] Input- Synchronous Data input signals, sampled on the rising edge of K and K clocks d uring va lid write operations . CY7C1292DV18 - D [1 7:0] CY7C1294DV18 - D [3 5:0] WPS Input- Synchronous Write Port Select, active LOW .
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 5 of 23 Functional Overview The CY7C1292DV18 a nd CY7C1294DV1 8 are synchronou s pipelined Burst SRAMs equipp ed with both a Read port and a Write port. The Read port is dedicated to Read operations and the Write port is dedicated to Write operations.
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 6 of 23 Byte Write Operations Byte Write operations are supported by the CY7C1292DV18. A Write operation is initiated as described in the Write Opera- tions section above. The bytes that are w ritten are determined by BWS 0 and BWS 1 , which are sampled with each 18-bit da ta word.
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 7 of 23 Application Example [1] T ruth T able [2, 3, 4, 5, 6, 7] Operation K RPS WPS DQ DQ Write Cycle: Load address on the rising e dge of K clock; i nput write data on K and K rising edges.
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 8 of 23 Write Cycl e Descriptions (CY7C1294DV18 ) [2, 8] BWS 0 BWS 1 BWS 2 BWS 3 KK Comments L L L L L-H - During the Data portion of a Write sequence, all four bytes (D [35:0] ) are written into the device.
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 9 of 23 IEEE 1 149.1 Serial Boundary Scan (JT AG) These SRAMs incorporate a serial bo undary scan test access port (T AP) in the FBGA package. This part is fully compliant with IEEE S tandard #1 149.
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 10 of 23 IDCODE The IDCODE instruction causes a ven dor-specific, 32-bit code to be loaded into the instruction re gister .
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 1 1 of 23 Note: 9. The 0/1 next to each state re present s the value at TMS at the rising edge of TCK.
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 12 of 23 T AP Controller Block Diagram 0 0 1 2 . . 29 30 31 Boundary Scan Register Identification Register 0 1 2 .
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 13 of 23 T AP AC Switching Characteristics Over the Operating Range [13, 14] Parameter Description Min.
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 14 of 23 Identification Register Definitions Instruction Field Va l u e Description CY7C1292DV18 CY7C1294DV18 Revision Number (31:29) 000 000 V ersion number . C y p r e s s D e v i c e I D ( 2 8 : 1 2 ) 1 101001 10100101 10 1 101001 10101001 10 D e f i n e s t h e t y p e o f S R A M .
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 15 of 23 Boundary Scan Order Bit # Bum p ID Bit # Bump ID Bit # Bump ID Bit # Bump ID 0 6R 27 1 1H 54 7B 81 3G 1 6P 28 10G 55 6B 82 2G 26 .
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 16 of 23 Power-Up Sequence in QDR-II SRAM [16] QDR-II SRAMs must be powered up and initialized in a predefined manner to prevent undefined opera tions.
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 17 of 23 Maximum Ratings (Above which the useful life may be impaired.) S torage T emperature ............. .............. ...... –65°C to +150°C Ambient T emperature with Power Applied .
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 18 of 23 Note: 22. Unless otherwise noted, test conditions assume sign al transiti on time of 2V/ns, timing reference levels of 0.75V , Vr ef = 0.75V , RQ = 250 Ω , V DDQ = 1.5V , input pulse levels of 0.
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 19 of 23 Switching Characteristics Over the Operating Range [22, 23] Cypress Parameter Consortium Parameter Descriptio n 250 MHz 200 MHz 16 7 MHz Unit Min.
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 20 of 23 Switching W aveforms [27, 28, 29] Read/Write/Deselect Sequence Notes: 27. Q00 refers to outp ut from address A0. Q01 refers to output from t he next internal burst addr ess following A0, i.
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 21 of 23 Ordering Information Not all of the spee d, package and temperature ranges are a vailable. Please c ontact your local sales representative or visit www .cyp ress.com for actual pr oducts offered.
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 22 of 23 © Cypress Semi con duct or Cor po rati on , 20 06 . The information con t a in ed he re i n is su bject to change wit hou t n otice.
CY7C1292DV18 CY7C1294DV18 Document #: 001-00350 Rev . *A Page 23 of 23 Document History Page Document Title: CY7C1292DV18/CY7C1294DV18 9-Mbit QDR- II™ SRAM 2-Word Burst Architecture Document Number: 001-00350 REV .
デバイスCypress Semiconductor CY7C1292DV18の購入後に(又は購入する前であっても)重要なポイントは、説明書をよく読むことです。その単純な理由はいくつかあります:
Cypress Semiconductor CY7C1292DV18をまだ購入していないなら、この製品の基本情報を理解する良い機会です。まずは上にある説明書の最初のページをご覧ください。そこにはCypress Semiconductor CY7C1292DV18の技術情報の概要が記載されているはずです。デバイスがあなたのニーズを満たすかどうかは、ここで確認しましょう。Cypress Semiconductor CY7C1292DV18の取扱説明書の次のページをよく読むことにより、製品の全機能やその取り扱いに関する情報を知ることができます。Cypress Semiconductor CY7C1292DV18で得られた情報は、きっとあなたの購入の決断を手助けしてくれることでしょう。
Cypress Semiconductor CY7C1292DV18を既にお持ちだが、まだ読んでいない場合は、上記の理由によりそれを行うべきです。そうすることにより機能を適切に使用しているか、又はCypress Semiconductor CY7C1292DV18の不適切な取り扱いによりその寿命を短くする危険を犯していないかどうかを知ることができます。
ですが、ユーザガイドが果たす重要な役割の一つは、Cypress Semiconductor CY7C1292DV18に関する問題の解決を支援することです。そこにはほとんどの場合、トラブルシューティング、すなわちCypress Semiconductor CY7C1292DV18デバイスで最もよく起こりうる故障・不良とそれらの対処法についてのアドバイスを見つけることができるはずです。たとえ問題を解決できなかった場合でも、説明書にはカスタマー・サービスセンター又は最寄りのサービスセンターへの問い合わせ先等、次の対処法についての指示があるはずです。